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先列真值表，再求表達式，將表達式轉化成與非格式，最後就能畫出來電路圖了，典型的組合邏輯電路。A+B+CI=S+CO，其中，A、B是加數，CI是前進位，S是和，CO是後進位。有字數限製，想給你畫，也畫不了。
無法用與或非門設計一位全加器，因為一位全加器是用門電路實現兩個二進製數相加並求出和的組合線路。它隻能利用門電路實現，而無法用與或非門實現。
） 輸入並調出校準信號波形 ，校準信號輸出端通過專用電纜與 Y1（或 Y2）輸入通道接通，根據實驗原理中有關示波器的描述， 正確設置和調節示波器各控製按鈕、有關旋鈕，將校準信號波形顯示在熒光屏上。
用於門電路實現兩個二進製數相加並求出和的組合線路，稱為一位全加器。一位全加器可以處理低位進位，並輸出本位加法進位。多個一位全加器進行級聯可以得到多位全加器。常用二進製四位全加器74LS283。
比如32位+32位，就需要32個全加器；這種級聯就是串行結構速度慢，如果要並行快速相加可以用超前進位加法。
AAAA4接輸入A、B、C、D，BBCI接地，BB0接高電平，輸出CO懸空，SSSS0就是輸出YYYY0。就可以將輸入的四位BCD碼轉化成餘三碼。
全加器電路的輸入是兩個二進製數，輸出是這兩個數的和。
假設要實現A X B，利用門電路搭一個2-4譯碼器。2-4譯碼器的輸入信號為A；然後用2-4譯碼器的輸出控製一個4路選擇器，4路選擇器的4個輸入分別是0，B，B+B，B+B+B，這部分用二位全加器實現。
由於二進製運算可以用邏輯運算來表示，因此可以用邏輯設計的方法來設計運算電路。加法在數字係統中分為全加和半加，所以加法器也分為全加器和半加器。 半加器不考慮低位向本位的進位，因此它有兩個輸入端和兩個輸出端。
示波器內的校準信號 用機內校準信號（方波：f=1KHz VP—P=1V）對示波器進行自檢。
1、Ci是任意一位進位位，圖中是C0、CCC3中的任一位，Ci-1是第i-1位，即任意一位進位位的低一位，假設Ci=C2，則Ci-1=C1。
2、一位全加器的真值表如下圖，其中Ai為被加數，Bi為加數，相鄰低位來的進位數為Ci-1，輸出本位和為Si。
3、英語名稱為full-adder，是用門電路實現兩個二進製數相加並求出和的組合線路，稱為一位全加器。一位全加器可以處理低位進位，並輸出本位加法進位。多個一位全加器進行級聯可以得到多位全加器。
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